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    Inicio - Registro de desplazamiento de entrada serie/salida paralela de 8 bits – EEWeb
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    Registro de desplazamiento de entrada serie/salida paralela de 8 bits – EEWeb

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    Registro de desplazamiento de entrada serie/salida paralela de 8 bits - EEWeb
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    El 74AHC164 y el 74AHCT164 son registros de desplazamiento de entrada en serie/salida en paralelo de 8 bits clasificados como dispositivos CMOS de puerta de silicio de alta velocidad. Estos dispositivos son compatibles con clavijas con Schottky TTL de baja potencia (LSTTL) y se especifican de acuerdo con el estándar JEDEC n.º 7A. La señal de entrada es serie de 8 bits a través de una de dos entradas (DSA o DSB). Cualquiera de las entradas se puede usar como una habilitación alta activa para la entrada de datos a través de la otra entrada. Ambas entradas deben vincularse juntas o la entrada no utilizada debe vincularse a ALTO. Los datos se desplazan uno a la derecha en cada transición de BAJO a ALTO de la entrada de reloj (CP) y en la salida Q0. Este es el AND lógico de las dos entradas de datos (DSA y DSB) que existían en un momento de configuración. Antes del borde ascendente del reloj. Un nivel BAJO en la entrada de reinicio maestro (MR) anula todas las demás entradas, borra los registros de forma asíncrona y fuerza todas las salidas a BAJO.

    característica

    • retardo de propagación equilibrada
    • Todas las entradas tienen acción de disparador Schmitt
    • La entrada acepta voltajes superiores a VCC
    • Nivel de entrada:
      • Para 74AHC164: nivel CMOS
      • Para 74AHCT164: nivel TTL
    • Protección ESD:
      • HBM EIA/JESD22-A114E supera los 2000 V
      • MM EIA/JESD22-A115-A por encima de 200 V
      • CDM EIA/JESD22-C101C supera los 1000 V
    • Múltiples opciones de paquetes
    • Especificado de -40 °C a +85 °C y de -40 °C a +125 °C

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