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    Home»Noticias»Electrónica»ADC doble de 14 bits y 250 MSPS – EEWeb
    Electrónica

    ADC doble de 14 bits y 250 MSPS – EEWeb

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    ADC doble de 14 bits y 250 MSPS - EEWeb
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    El ADS4249 es miembro de la familia ADS42xx de potencia ultrabaja de convertidores de analógico a digital (ADC) de dos canales y 12 bits/14 bits. Utiliza técnicas de diseño innovadoras para lograr un consumo de energía extremadamente bajo con un suministro de 1,8 V y al mismo tiempo lograr un alto rendimiento dinámico. Esta topología hace que el ADS4249 sea ideal para aplicaciones de comunicación de gran ancho de banda y multiportadora.

    ADC de potencia ultrabaja de dos canales y 250 MSPS de 14 bits

    El ADS4249 es miembro de la familia ADS42xx de potencia ultrabaja de convertidores de analógico a digital (ADC) de dos canales y 12 bits/14 bits. Utiliza técnicas de diseño innovadoras para lograr un consumo de energía extremadamente bajo con un suministro de 1,8 V y al mismo tiempo lograr un alto rendimiento dinámico. Esta topología hace que el ADS4249 sea ideal para aplicaciones de comunicación de gran ancho de banda y multiportadora.

    El ADS4249 tiene opciones de ganancia que se pueden usar para mejorar el rendimiento de SFDR en rangos de entrada de escala completa más bajos. El dispositivo también incluye un bucle de corrección de compensación de CC que se puede usar para cancelar las compensaciones de ADC. Las interfaces de salida digital DDR LVDS y CMOS paralelas se ofrecen en un paquete compacto QFN-64 PowerPAD™.

    El dispositivo incluye una referencia interna, eliminando los condensadores de desacoplamiento asociados con los pines de referencia tradicionales. El ADS4249 se especifica en el rango de temperatura industrial (-40 °C a +85 °C).

    característica

    • Tasa de muestreo máxima: 250MSPS
    • Energía ultrabaja de un solo suministro de 1,8 V:
    • Potencia total de 560 mW a 250 MSPS
    • Alto rendimiento dinámico:
    • SFDR de 80 dBc a 170 MHz
    • 71,7 dBFS SNR a 170 MHz
    • Diafonía: > 90 dB a 185 MHz
    • Ganancia programable hasta 6 dB
    • Compensación SNR/SFDR
    • Corrección de compensación de CC
    • Opciones de interfaz de salida:
    • Interfaz CMOS paralela de 1,8 V
    • Velocidad de datos doble (DDR) LVDS con oscilación programable:
    • Oscilación estándar: 350 mV
    • Columpio bajo: 200mV
    • Soporta baja amplitud de reloj de entrada
    • Hasta 200mVPP
    • Paquete: 9 mm × 9 mm, paquete quad flat sin plomo (QFN) de 64 pines

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